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源碼之巔峰

MIPS五級流水線CPU+cache設計

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發布日期: 2021-04-01
語言: 其他
標簽: verilog??cache??流水線??MIPS??CPU??

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資源簡介

verilog編寫的MIPS五級流水線，實現四十余條指令，使用512B的一級數據cache（高速緩存）。附帶測試程序與說明文檔。

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