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    文件類型: .doc
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    發布日期: 2023-09-21
  • 語言: 其他
  • 標簽: VHDL??FPGA??EDA??

資源簡介

設計一個奇偶檢驗器,要求模擬串行數據輸入,并可對其進行奇偶校驗。例如對于1位開始位、8位數據位和1位奇偶校驗位的10位串行數據,由1個按鍵根據時序逐個輸入,數碼管應實時提示當前應輸入的數據序號;奇校驗或偶校驗模式應能設置,odd代表奇校驗,eve表示偶校驗;顯示格式例子:顯示odd-9表示當前模式為奇校驗,當前應輸入第9位(即數據位的第8位)數據;顯示odd-PASS則表示奇校驗通過;顯示odd-FFFF則表示奇校驗失敗。校驗通過時發出嘀-嘀-嘀三聲提示。

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