資源簡介
實測親測xilinx fpga uart 串口rs232例子實例工程，ISE打包工程，不出錯發送接收數據測試，無狀態機，節省資源3根線串口，可以學習rs232串口和倍頻ip core用法，字節編寫，用verilog編寫
基于一個xilinx的學習板子，具體io配置請看工程，測試內容內容是 pc 用 uart rs232發一個字節到fpga，fpga收到之后馬上把字節加1發回給pc，uart的波特率是50m時鐘，用到了ise的pll倍頻，可以學習pll用法，uart 的 verilog 代碼沒有用到狀態機，只用到txd，rxd，gnd這3根最基本的串口通訊線，極大的簡化了fpga資源。整個工程打包，方便大家下載到之后可以馬上用，相信對初學xilinx fpga 或者 ip cone用法的初學者來說，學習很用幫助。
代碼片段和文件信息
?屬性????????????大小?????日期????時間???名稱
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????I.A....??????2270??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\prev_cmp_uart_test.asm.qmsg
????I.A....?????25015??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\prev_cmp_uart_test.fit.qmsg
????I.A....?????16838??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\prev_cmp_uart_test.map.qmsg
????I.A....????111282??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\prev_cmp_uart_test.qmsg
????I.A....?????66927??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\prev_cmp_uart_test.tan.qmsg
????I.A....??????2184??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.（0）.cnf.cdb
????I.A....??????1121??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.（0）.cnf.hdb
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????I.A....??????1398??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.（1）.cnf.hdb
????I.A....??????5007??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.（2）.cnf.cdb
????I.A....??????1549??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.（2）.cnf.hdb
????I.A....??????1576??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.（3）.cnf.cdb
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????I.A....????????28??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.cmp.ecobp
????I.A....?????12511??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.cmp.hdb
????I.A....???????340??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.cmp.kpt
????I.A....?????????4??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.cmp.logdb
????I.A....?????27588??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.cmp.rdb
????I.A....?????27277??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.cmp.tdb
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............此處省略79個文件信息
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????I.A....???????176??2014-12-09?11:46??2014.12.00備份的vhdl?fpga?verilog代碼?uart串口?串口用pll的接收后加1回發給pc，不出錯，goodmy_uart1_VERILOG\my_uart1\db\uart_test.eco.cdb
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............此處省略79個文件信息
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