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使用verilog hdl 語言使FPGA輸出1KHz方波.html
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大小: 3KB
文件類型: .html
金幣: 1
下載: 1 次
發布日期: 2021-05-15
語言
:
Html/CSS
標簽
:
FPGA
??
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資源簡介
本項目所用實現1KHz方波的代碼是本人從流水燈代碼改編過來的。 該代碼除了能夠實現1KHz方波以外也可以通過小小的改變能夠實現50MHz及一下頻率的方波。對于實現50MHz頻率以上的建議使用鎖相環(PLL)方法,也并不是很難,以后我會發出有關利用PLL實現50MHz頻率以上方波的過程。
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